Publication

Case Study of Fault-Tolerant Architectures for 90nm CMOS Cryptographic Cores

Yusuf Leblebici, Alexandre Schmid, Milos Stanisavljevic
2007
Conference Papers

Résumé

This paper presents a case study of different fault-tolerant architectures. The emphasis is on the silicon realization. A 128bit AES cryptographic core has been designed and fabricated as a main topology on which the fault-tolerant architectures have been applied. One of the fault-tolerant architectures is a novel four-layer architecture exhibiting a large immunity to permanent as well as random failures. Characteristics of the averaging/ thresholding layer are emphasized. Measurement results show advantage of four-layer architecture over triple modular redundancy in terms of reliability.

Source officielle

https://infoscience.epfl.ch/entities/publication/dbb21b5a-6bb8-4c74-bcb8-7afdd37631f7

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