Séance de cours

NIOS II - Bus d'Avalon

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Dans cours

CS-476: Embedded system design

Hardware-software co-design is a well known concept in embedded system design.It is also a concept required in designing FPGA-accelerators in data-centers.This course teaches how to transform algorithms in smart hardware-software solutions. ...

Description

Cette séance de cours couvre l'architecture d'un système intégré sur FPGA, mettant l'accent sur le processeur softcore NIOS II et l'Avalon Bus. Les sujets abordés comprennent la conception d'interfaces spécifiques, la structure du processeur NIOS II et les principes du tissu Avalon Switch. La séance de cours traite également des gains de performance obtenus grâce à des instructions personnalisées et des accélérateurs matériels. En outre, il explore l'architecture informatique sur FPGA, l'architecture SOPC et l'exemple système sur FPGA. La séance de cours conclut en soulignant les avantages et les inconvénients d'une architecture softcore pour les systèmes embarqués.

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Enseignant·e

Ties Jan Henderikus Kluter

Since January 2011: Teaching digital systems at the Swiss Federal Institute of Technology, Lausanne Switzerland Since August 2009: Teaching responsible for digital systems at the university of applied science of Bern, Bienne Switzerland 2003-2010: Ph.D. candidate at the Swiss Federal Institute of Technology, Lausanne Switzerland 2002-2003: Product development team leader in the infotainment group of Agere Systems, Nieuwegein The Netherlands. 1997-2003: Design Engineer in the design services group of Dedris Embedded Algorithms/Frontier Design BV./Adelante Technologies, Tiel The Netherlands 1996-1997: Assistant R&D at the faculty of computer controlled systems and computer techniques University of Twente, Enschede The Netherlands 1992-1996: MSc. education at the Technical University of Twente, Enschede The Netherlands 1988-1992: Bc. edudation at the Higher Technical School of Groningen, Groningen The Netherlands

Source officielle

Proximité ontologique

Génie informatique

Matériel informatique: Microprocesseur

Concepts associés (32)

Architecture matérielle

vignette|Architecture matérielle d'un processeur Intel Core2. vignette|Architecture matérielle d'un Cyclops64 (BlueGene/C). L’architecture matérielle décrit l’agencement interne de composants électroniques ainsi que leurs interactions. Le terme interne employé ici permet de bien faire la différence avec l’architecture (externe) de processeur (ou architecture de jeu d'instruction), qui s'intéresse à la spécification fonctionnelle d'un processeur, du point de vue du programmeur en langage machine.

Architecture de von Neumann

L’architecture dite architecture de von Neumann est un modèle pour un ordinateur qui utilise une structure de stockage unique pour conserver à la fois les instructions et les données demandées ou produites par le calcul. De telles machines sont aussi connues sous le nom d’ordinateur à programme enregistré. La séparation entre le stockage et le processeur est implicite dans ce modèle. Cette architecture est appelée ainsi en référence au mathématicien John von Neumann, qui a élaboré en juin 1945 dans le cadre du projet EDVAC la première description d’un ordinateur dont le programme est stocké dans sa mémoire.

Mot (architecture informatique)

En architecture informatique, un mot est une unité de base manipulée par un microprocesseur. On parle aussi de mot machine. La taille d’un mot s’exprime en bits, parfois même en octets. Elle est souvent utilisée pour classer les microprocesseurs (, ). Toutes choses étant égales par ailleurs, un microprocesseur est d’autant plus rapide que ses mots sont longs, car les données qu'il traite à chaque cycle sont plus importantes.

Optimisation de code

En programmation informatique, l'optimisation de code est la pratique consistant à améliorer l'efficacité du code informatique d'un programme ou d'une bibliothèque logicielle. Ces améliorations permettent généralement au programme résultant de s'exécuter plus rapidement, de prendre moins de place en mémoire, de limiter sa consommation de ressources (par exemple les fichiers), ou de consommer moins d'énergie électrique. La règle numéro un de l'optimisation est qu'elle ne doit intervenir qu'une fois que le programme fonctionne et répond aux spécifications fonctionnelles.

Field-programmable gate array

A field-programmable gate array (FPGA) is an integrated circuit designed to be configured after manufacturing. The FPGA configuration is generally specified using a hardware description language (HDL), similar to that used for an application-specific integrated circuit (ASIC). Circuit diagrams were previously used to specify the configuration, but this is increasingly rare due to the advent of electronic design automation tools. FPGAs contain an array of programmable logic blocks, and a hierarchy of reconfigurable interconnects allowing blocks to be wired together.

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Séances de cours associées (64)

Mémoire cache

Explore la conception de mémoire cache, les succès, les ratés et les politiques d'expulsion dans les systèmes informatiques, en mettant l'accent sur la localité spatiale et temporelle.

CS-200 -- 1c. Instruction Set Architecture

Capture directe et caches de l'annexe

Couvre les caches en format direct et annexe dans l'architecture informatique, expliquant la structure du cache, les modèles d'accès, les taux de succès et les calculs de latence.

Mémoires : Evolution et types

Explore l'évolution et la taxonomie des souvenirs, en se concentrant sur les différences SRAM et DRAM, la disposition de la mémoire et la taxonomie fonctionnelle.

Programmation FPGA avec Speedgoat : traitement du signal en temps réel

Met l'accent sur la mise en œuvre d'un générateur de fonctions carrées utilisant la technologie Speedgoat FPGA et les techniques de traitement du signal en temps réel.

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Architecture matérielle

Architecture de von Neumann

Mot (architecture informatique)

Optimisation de code

Field-programmable gate array

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