Séance de cours

Microcontrôleurs Fondamentaux

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Dans cours (2)

EE-208: Microcontrôleurs et systèmes numériques

Microcontrôleurs et conception de systèmes numériques couvre le fonctionnement interne d'un microcontrôleur, des notions de base d'architecture de processeur et de système informatique ainsi que les interfaces de microcontrôleurs, et protocoles de communic ...

MICRO-210: Microcontrôleurs

Microcontrôleurs couvre le fonctionnement interne d'un microcontrôleur, des notions de base d'architecture de processeur et de système informatique ainsi que les interfaces de microcontrôleurs, et protocoles de communication série. ...

Description

Cette séance de cours couvre les fondamentaux des microcontrôleurs, y compris les opérations, les pointeurs, les transmissions en série, les sous-programmes, l'architecture de mémoire, l'adressage indirect, les techniques en temps réel, les interruptions, la gestion des interruptions et les vecteurs d'interruption. Il traite également de la configuration des interruptions, des mécanismes de réinitialisation, du traitement des interruptions, des vecteurs d'interruption et des routines de service d'interruption. L'instructeur explique l'importance de gérer les interruptions multiples, les interruptions imbriquées et la comparaison entre les sous-programmes et les interruptions. En outre, la séance de cours explore les concepts de niveaux de priorité d'interruption, les tables vectorielles d'interruption et la séquence d'exécution des routines de service d'interruption.

Enseignant·e

Alexandre Schmid

Enseignement et PhD A dirigé les thèses EPFL de Mahsa Shoaran, Wen-Yang Hsu, Reza Ranjandish, Keyvan Farhang Razi, Mohammad Javad Karimi A co-dirigé les thèses EPFL de Milos Stanisavljevic, Neil Joye, Vahid Majidzadeh Bafar, Hossein Afshari, Nikola Katic, Abdulkadir Akin Cours Analog circuits for biochip EE-518 Introduction à la conception analogique CMOS pour des biocapteurs à distance sur puce. Compréhension et la conception de systèmes de biocapteurs actifs et alimentés à distance. Compré

Source officielle

Proximité ontologique

Génie informatique

Calcul intensif: Système temps réel

Concepts associés (29)

Interrupt handler

In computer systems programming, an interrupt handler, also known as an interrupt service routine or ISR, is a special block of code associated with a specific interrupt condition. Interrupt handlers are initiated by hardware interrupts, software interrupt instructions, or software exceptions, and are used for implementing device drivers or transitions between protected modes of operation, such as system calls. The traditional form of interrupt handler is the hardware interrupt handler.

Programmable interrupt controller

In computing, a programmable interrupt controller (PIC) is an integrated circuit that helps a microprocessor (or CPU) handle interrupt requests (IRQ) coming from multiple different sources (like external I/O devices) which may occur simultaneously. It helps prioritize IRQs so that the CPU switches execution to the most appropriate interrupt handler (ISR) after the PIC assesses the IRQ's relative priorities. Common modes of interrupt priority include hard priorities, rotating priorities, and cascading priorities.

Interrupt latency

In computing, interrupt latency refers to the delay between the start of an Interrupt Request (IRQ) and the start of the respective Interrupt Service Routine (ISR). For many operating systems, devices are serviced as soon as the device's interrupt handler is executed. Interrupt latency may be affected by microprocessor design, interrupt controllers, interrupt masking, and the operating system's (OS) interrupt handling methods. There is usually a trade-off between interrupt latency, throughput, and processor utilization.

Non-maskable interrupt

In computing, a non-maskable interrupt (NMI) is a hardware interrupt that standard interrupt-masking techniques in the system cannot ignore. It typically occurs to signal attention for non-recoverable hardware errors. Some NMIs may be masked, but only by using proprietary methods specific to the particular NMI. An NMI is often used when response time is critical or when an interrupt should never be disabled during normal system operation.

Inter-processor interrupt

In computing, an inter-processor interrupt (IPI), also known as a shoulder tap, is a special type of interrupt by which one processor may interrupt another processor in a multiprocessor system if the interrupting processor requires action from the other processor. Actions that might be requested include: flushes of memory management unit caches, such as translation lookaside buffers, on other processors when memory mappings are changed by one processor; stopping when the system is being shut down by one processor.

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Séances de cours associées (63)

Chronomètres et compteurs : Architecture et applications

Explore l'architecture et les applications des minuteurs et des compteurs dans les microcontrôleurs pour générer des bases de temps et des signaux précis.

Mélodies à jouer : minuterie et interruption

Explique le jeu de mélodies à l'aide de minuteurs et d'interruptions sur microcontrôleurs, couvrant les notes, les périodes, les durées et la mise en œuvre des capteurs.

Comprendre les perturbations des microcontrôleurs

Explore les interruptions des microcontrôleurs, couvrant les types, les vecteurs, les catégories et les méthodes de manipulation, en mettant l'accent sur la complexité interne et la facilité de programmation.

Interruptions : principes et mise en œuvre

Examine les principes et la mise en œuvre des interruptions dans les microcontrôleurs, couvrant la motivation, les sources et des exemples pratiques.

Protection des processus et exécution efficace

Explore l'exécution des processus, la protection et les mécanismes d'exploitation efficaces pour des environnements multi-programmes sécurisés et fiables.

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Concepts associés (29)

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Programmable interrupt controller

Interrupt latency

Non-maskable interrupt

Inter-processor interrupt

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