Publication

DRSA: Accelerating Macro Placement on Commercial FPGAs

Paolo Ienne, Andrea Guerrieri, Lana Josipovic, Menzo Bouaïssi
2025

Résumé

PGAs are highly versatile devices, but their backend compilation process is significantly time-consuming. DynaRapid has demonstrated the potential to drastically reduce compilation times to mere seconds by leveraging macro-component-based design hierarchies [1]. However, DynaRapid faces challenges in macro-component placement, often resulting in frequency degradation. In this work, we propose DRSA, a fast placer based on simulated annealing targeting DynaRapid's macros, capable of overcoming the frequency degradation of the previous greedy placement strategy [1]

Source officielle

https://infoscience.epfl.ch/entities/publication/93d2e95d-ee63-41b6-a806-ffec4c071d5f

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